Debussy怎么看wire数组？

sonicsun · 发表于 2011-11-18 11:00:37

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Verilog2001支持wire型数组，例如可以定义 wire[3:0] syn_sig[0:15];

怎么在Debussy下看这个？可以把wire型数组当做memory来debug么？或者有什么别的途径呢？

xdic · 发表于 2011-11-28 17:57:46

看帮助文档啊我记得可以直接dump的

remnant · 发表于 2011-11-28 20:29:04

$fsdbDumpMem

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