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楼主: buley

[统计] 你是用VHDL还是用Verilog HDL?

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发表于 2012-4-23 23:03:55 | 显示全部楼层
都用过,但主要还是用verilog
发表于 2012-4-24 00:17:10 | 显示全部楼层
almost verilog.
发表于 2012-4-24 14:53:43 | 显示全部楼层
verilog 现在用VHDL的越来越少了
发表于 2012-4-26 11:19:17 | 显示全部楼层
平时用verilog,不过VHDL也会
发表于 2012-4-29 12:17:08 | 显示全部楼层
verilog HDL比较好上手
发表于 2012-4-30 20:33:25 | 显示全部楼层
看需要了,没有优劣之分
发表于 2012-5-6 15:38:51 | 显示全部楼层
回复 1# buley


   verilog is my favorite
发表于 2012-5-7 23:10:54 | 显示全部楼层
verilog
发表于 2012-5-9 09:07:53 | 显示全部楼层
System Verilog is great!! Very good from system design to testbench development!!
发表于 2012-5-11 04:23:10 | 显示全部楼层
verilog更直接
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