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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › 硬件设计论坛 › 电路设计论坛(数字/模拟) › 电路设计资料 › 夏宇闻Verilog_HDL数字设计与综合(第二版)
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楼主: feiniao114

[资料] 夏宇闻Verilog_HDL数字设计与综合(第二版)

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发表于 2018-4-29 12:16:16 | 显示全部楼层
谢谢你的
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weiquji
发表于 2018-4-29 17:06:28 | 显示全部楼层
基础的好东西
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发表于 2018-5-2 10:47:39 | 显示全部楼层
thank s
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发表于 2018-6-8 10:41:28 | 显示全部楼层
有时候还是需要看看基础
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raymo
发表于 2018-6-12 23:33:07 | 显示全部楼层
谢谢分享！！！
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发表于 2018-7-3 14:51:01 | 显示全部楼层
thanks for lz sharing~~~
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发表于 2018-7-22 16:54:59 | 显示全部楼层
顶顶！！！！！！！！！！
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发表于 2018-7-23 11:02:38 | 显示全部楼层
thanks
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liuzgyt
发表于 2018-8-4 11:35:04 | 显示全部楼层
好资料 学习了
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发表于 2018-10-18 23:28:49 | 显示全部楼层
楼主的资源很好，有书签
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