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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog、SystemC、UVM 语法高亮（gvim)

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楼主: sinva

[资料] SystemVerilog、SystemC、UVM 语法高亮（gvim)

发表于 2018-1-18 10:25:06 | 显示全部楼层

多谢分享！

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发表于 2018-2-24 15:04:28 | 显示全部楼层

再加一赞，等我有好东西也拿出来分享

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发表于 2018-2-26 21:57:16 | 显示全部楼层

谢谢楼主

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毛豆爱叶子

发表于 2018-3-1 13:15:21 | 显示全部楼层

ok i will try it!

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毛豆爱叶子

发表于 2018-3-8 15:32:50 | 显示全部楼层

正是现在需要的

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发表于 2018-3-9 23:49:46 | 显示全部楼层

之前有过一个vmm的，更新更新

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发表于 2018-3-10 16:25:02 | 显示全部楼层

谢谢楼主下载下来学习

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发表于 2018-5-13 11:17:40 | 显示全部楼层

不错。。好东西支持一个。。

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发表于 2018-5-27 21:41:20 | 显示全部楼层

谢谢分享

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发表于 2018-6-11 15:58:47 | 显示全部楼层

谢谢分享

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