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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 一个有符号的16位乘法器的verilog代码
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楼主: Ames

[原创] 一个有符号的16位乘法器的verilog代码

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发表于 2016-12-25 18:44:17 | 显示全部楼层
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发表于 2016-12-28 15:16:23 | 显示全部楼层
回复 1# Ames


   感觉楼主挺厉害的
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发表于 2017-2-22 15:56:49 | 显示全部楼层
多谢楼主分享
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发表于 2017-3-17 11:37:34 | 显示全部楼层
谢谢分享
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cwpeng
发表于 2017-3-24 14:52:45 | 显示全部楼层
原創值得大大的鼓勵，感謝您的分享。
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yy2122
发表于 2017-4-27 14:59:09 | 显示全部楼层
非常感谢！！！！！！！！！！！！！！
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发表于 2018-8-21 14:03:02 | 显示全部楼层
谢谢分享
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发表于 2018-9-2 16:26:39 | 显示全部楼层
谢谢分享
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发表于 2018-9-14 18:10:26 | 显示全部楼层
谢谢分享
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zpwang
发表于 2018-9-15 07:28:45 | 显示全部楼层
谢谢!学习一下.
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