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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › Synopsys 《VMM for SystemVerilog》中文版
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楼主: lygany

[资料] Synopsys 《VMM for SystemVerilog》中文版

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gangsterzhang
发表于 2013-12-27 20:45:58 | 显示全部楼层
HHHHHHHHHHHHHHHHHHHHHHHHH
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student321
发表于 2013-12-29 21:32:17 | 显示全部楼层
支持一下
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xingqiwu1230
发表于 2014-1-2 16:47:31 | 显示全部楼层
貌似还可以，多谢~
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gangsterzhang
发表于 2014-1-2 20:06:34 | 显示全部楼层
hhhhhhhhhhhhhhhhhhhhhhhhhh
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gsy703
发表于 2014-1-4 21:49:26 | 显示全部楼层
的确 好东西，成分感谢
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dongjixuan
发表于 2014-1-25 12:31:36 | 显示全部楼层
很好 heNNICE
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zindy
发表于 2014-1-26 12:44:42 | 显示全部楼层
这个也有中文版了
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yqnie
发表于 2014-2-3 11:13:08 | 显示全部楼层
GOOD, UP UP UP
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liuxuejielxj
发表于 2014-3-26 17:13:30 | 显示全部楼层
中文的啊，真好
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allenzmj
发表于 2014-5-5 17:01:54 | 显示全部楼层
最近在看vmm 很有用 谢谢了
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