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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › System Verilog 讲座
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楼主: dwd361

[资料] System Verilog 讲座

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发表于 2011-3-19 16:38:00 | 显示全部楼层
谢谢分享 好资料！
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xzcpj
发表于 2011-3-19 18:16:08 | 显示全部楼层
正在找你那。
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发表于 2011-4-2 15:30:32 | 显示全部楼层
不会现在SV就已经出山了吧。
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miles
发表于 2011-4-17 05:11:16 | 显示全部楼层
thanks a lot
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tomlxy
发表于 2011-4-20 21:56:33 | 显示全部楼层
下来瞧瞧~~
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发表于 2012-5-6 22:25:02 | 显示全部楼层
夏老师做verilog真是不遗余力啊，多谢分享
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发表于 2012-5-7 17:01:29 | 显示全部楼层
看看 谢谢
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发表于 2012-5-7 17:01:49 | 显示全部楼层
看看 谢谢
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zgj07
发表于 2012-5-7 19:40:40 | 显示全部楼层
非常感谢，赞一个
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Jayshier
发表于 2012-5-12 14:10:28 | 显示全部楼层
download it and check
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