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楼主: wangxuede220

[求助] 请问DC综合的乘法器是什么类型的?有必要再用verilog专门写一个乘法器吗?

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发表于 2012-8-16 13:46:50 | 显示全部楼层
  高手指点~~~~~~~~~~~~~~~~
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发表于 2012-8-16 16:15:06 | 显示全部楼层
挺有用的
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发表于 2016-9-13 18:22:06 | 显示全部楼层




    楼主你好,你的意思是调用synopsys库里的固定的乘法器模型来实现乘法器?还是我们自己设计乘法器,在rtl代码里加上你提到的那几行命令,让DC综合成synopsys库里的乘法器。不知道我的理解是否正确?我现在自己想实现乘法器,但是最后的乘法器延迟不满足设计要求,所以我想按照你的方法来尝试做一下。但是不太明白你的做法,请你赐教啊!
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发表于 2016-9-13 23:03:40 | 显示全部楼层
学习了
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发表于 2017-3-12 11:39:25 | 显示全部楼层
回复 13# michaelzhang561


    楼主你好,我最近也在想写个自己的乘法器,然后自己的设计中全部使用自己的乘法器,有没有办法将操作符“*”直接指定为我的乘法器?谢谢楼主
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发表于 2017-4-11 14:47:13 | 显示全部楼层
回复 6# nan123chang


    楼主,有个问题想请教楼主,在写RTL代码时,写“*”乘号,怎样才能直接调用自己写得乘法器,而不使用designware里的乘法器啊?
谢谢楼主答疑啊
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发表于 2019-6-4 14:19:28 | 显示全部楼层


   
nan123chang 发表于 2010-10-20 12:04
20M没有问题。综合时指定一下乘法器的类型,比如Wallace乘法器。
// synopsys dc_script_begin
// set_impl ...


你好!请问后面的multi_u1是具体指什么呢
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发表于 2021-11-23 17:15:23 | 显示全部楼层


   
nan123chang 发表于 2010-10-20 12:04
20M没有问题。综合时指定一下乘法器的类型,比如Wallace乘法器。
// synopsys dc_script_begin
// set_impl ...


你好,请问这些都是什么意思,应该写在哪里,或者有什么教程指导该怎么写吗?谢谢
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