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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 成功解决FPGA设计时序问题的三大要点
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楼主: superlong

[资料] 成功解决FPGA设计时序问题的三大要点

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发表于 2010-6-14 09:45:36 | 显示全部楼层
good, thanks.
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发表于 2010-6-14 11:23:44 | 显示全部楼层
有点简单
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lgechao
发表于 2010-6-14 13:50:37 | 显示全部楼层
thanks
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发表于 2010-6-15 20:04:51 | 显示全部楼层
顶一顶，看看什么东西
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we231
发表于 2010-6-15 20:27:06 | 显示全部楼层
fdsafdhfh
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发表于 2010-6-15 20:45:26 | 显示全部楼层
到底内容丰富不？
划算不啊？
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发表于 2010-6-16 11:10:17 | 显示全部楼层
没讲到重点。 1# superlong
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gsm12345
发表于 2010-6-19 16:52:17 | 显示全部楼层
112611954
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jhshao
发表于 2010-6-20 21:13:24 | 显示全部楼层
谢谢，下来看看
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PYGH
发表于 2010-6-21 09:24:41 | 显示全部楼层
下来看看，谢谢楼主分享
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