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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › [讨论]乘法器原理与设计

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楼主: brotherjam

[讨论]乘法器原理与设计

发表于 2008-4-3 15:15:18 | 显示全部楼层

xialai

xialia zaishuo ba

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发表于 2008-4-3 15:16:12 | 显示全部楼层

bie fengwo

bie feng wo a

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发表于 2008-4-4 00:04:20 | 显示全部楼层

下来看看，谢谢!

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发表于 2008-4-30 22:55:34 | 显示全部楼层

kankan

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发表于 2008-4-30 23:31:08 | 显示全部楼层

Thanks a lot!

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发表于 2008-5-8 20:42:47 | 显示全部楼层

xiexie

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发表于 2008-5-13 16:51:20 | 显示全部楼层

好东西！谢谢！

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发表于 2008-5-14 13:11:44 | 显示全部楼层

谢谢啊

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发表于 2008-5-14 13:17:49 | 显示全部楼层

谢谢啊

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发表于 2008-7-29 01:20:53 | 显示全部楼层

低位的co作为相邻高位的4-2压缩器的ci输入，所以除了最高位的co没用到外，其他的co都在4-2压缩器组中消化掉了，但是最高位的co怎么办？难道符号扩展后就可以把最高位的co忽略掉？
或者是因为在华莱士树中，对于权重最大的部分积的最高位，其他的部分积的这个位都应为0，所以co必然为0，可以忽略。

[ 本帖最后由 gyezhz 于 2008-7-29 01:33 编辑 ]

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