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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Verilog的135个经典设计实例
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楼主: lurenyi

[资料] Verilog的135个经典设计实例

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adansong
发表于 2010-3-15 10:54:20 | 显示全部楼层
谢谢，我看看
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qmoo
发表于 2010-3-15 11:24:11 | 显示全部楼层
very good
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发表于 2010-3-15 11:30:57 | 显示全部楼层
好东西
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zz8318
发表于 2010-3-18 15:55:24 | 显示全部楼层
谢谢楼主，学习了
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zz8318
发表于 2010-3-18 15:59:28 | 显示全部楼层
谢谢楼主，学习了
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发表于 2010-3-18 16:00:56 | 显示全部楼层
顶！！！！！！！！！！！！
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发表于 2010-3-18 16:12:32 | 显示全部楼层
希望有用
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发表于 2010-3-19 13:57:41 | 显示全部楼层
非常感谢
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armmips
发表于 2010-4-4 04:44:03 | 显示全部楼层
感謝大大無私的分享
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yy225819
发表于 2010-4-12 12:39:20 | 显示全部楼层
很好 的东西。
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