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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Altera FPGA CPLD设计基础篇

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楼主: hjchen01

[资料] Altera FPGA CPLD设计基础篇

发表于 2012-7-8 18:09:16 | 显示全部楼层

很需要，多谢分享

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发表于 2012-7-28 06:42:24 | 显示全部楼层

谢谢啦

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发表于 2012-8-21 13:42:58 | 显示全部楼层

good data. too much

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发表于 2012-9-16 09:38:12 | 显示全部楼层

赚钱吧

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发表于 2012-9-16 09:41:23 | 显示全部楼层

这么多，没钱啊！

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发表于 2012-9-16 09:47:52 | 显示全部楼层

终于下完了za@

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发表于 2012-9-16 09:54:45 | 显示全部楼层

QQQDDDDDDDDDDDDDDD

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发表于 2012-9-24 22:07:31 | 显示全部楼层

回复 1# hjchen01

dgsagsddhggsafhsshhrehsdrhssdfhsh

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发表于 2012-9-30 14:07:17 | 显示全部楼层

多谢了

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发表于 2012-10-15 14:42:19 | 显示全部楼层

好的啊

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