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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 三星和MT的SD卡verilog与VHDL完整模型
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楼主: okokoklclclc

三星和MT的SD卡verilog与VHDL完整模型

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发表于 2009-8-25 12:42:00 | 显示全部楼层
xiexie
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发表于 2009-9-15 10:28:04 | 显示全部楼层
hao
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发表于 2009-9-15 22:33:14 | 显示全部楼层
看看先  谢了
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deffu
发表于 2009-9-15 22:41:03 | 显示全部楼层
good a good
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kka
发表于 2009-9-16 00:43:34 | 显示全部楼层
SD的資料很難找說....
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gaowl
发表于 2009-9-23 16:02:17 | 显示全部楼层
楼主啥意思，这不是SDRAM吗？不是SD卡呀
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gxxl
发表于 2009-9-28 18:47:53 | 显示全部楼层
看一下
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gxxl
发表于 2009-9-28 18:49:51 | 显示全部楼层
楼主搞什么，太不敬业了

SDRAM和SD卡都分不清楚吗
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发表于 2009-10-1 15:38:02 | 显示全部楼层
thanks for your sharing
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发表于 2009-10-1 16:04:21 | 显示全部楼层
thanks
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