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FPGA实现SVD分解

发表于 2009-6-9 22:10:14 | 显示全部楼层 |阅读模式

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有人实现过没有,指4阶以上复数矩阵的SVD分解,大家交流下如何,哪种算法快,觉得都很难达到500K矩阵/s啊. (用V5实现)

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