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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 原帖已删除

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楼主: tiger30

[其它] 原帖已删除

发表于 2009-9-2 14:46:50 | 显示全部楼层

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发表于 2009-9-2 14:47:59 | 显示全部楼层

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发表于 2009-9-4 14:35:23 | 显示全部楼层

thanks for sharing~~

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发表于 2009-9-4 14:36:34 | 显示全部楼层

不错的资料

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发表于 2009-9-4 17:59:47 | 显示全部楼层

嗯！谢谢楼主！对了，有人用PT做FPGA时序分析吗?

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发表于 2009-9-10 10:26:32 | 显示全部楼层

aaaaaaaaaaaaaaa

aaaaaaaaaaaaaaaaa

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发表于 2009-9-10 10:27:40 | 显示全部楼层

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发表于 2009-9-10 10:30:39 | 显示全部楼层

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发表于 2009-9-17 09:42:23 | 显示全部楼层

好贴，顶

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发表于 2009-9-17 09:43:33 | 显示全部楼层

还是不够，再顶！！我没有灌水，是发自内心的顶！

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