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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › JEDEC-Latch up 测试标准

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楼主: wll0411

JEDEC-Latch up 测试标准

发表于 2009-5-27 19:59:53 | 显示全部楼层

Thanks for sharing!

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发表于 2009-6-12 14:20:47 | 显示全部楼层

Thanks very much!

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发表于 2009-6-12 14:46:47 | 显示全部楼层

see a see

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发表于 2009-7-2 18:45:31 | 显示全部楼层

下来看看!!

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发表于 2009-7-30 07:47:32 | 显示全部楼层

good, thanks.

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发表于 2009-8-1 01:57:53 | 显示全部楼层

thanks for sharing!!!

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发表于 2009-9-9 15:04:05 | 显示全部楼层

正需要呢，雪中送炭

正需要呢，雪中送炭

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发表于 2010-3-13 13:38:11 | 显示全部楼层

看看了

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发表于 2010-3-13 17:10:22 | 显示全部楼层

Not only PE, design engineer should understand latch up as well. latchup is important for IO design, power IC and library designer.

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楼主| 发表于 2010-4-17 21:19:10 | 显示全部楼层

楼上说的太对了.

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