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楼主: iolinux

I2C总线VHDL/Verilog HDL源码.免费

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发表于 2006-8-22 18:58:37 | 显示全部楼层

谢谢了

谢谢了!!!!!!!!!!!!!!!1
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发表于 2006-8-22 19:05:08 | 显示全部楼层

想下却没有钱买,穷人一个

想下却没有钱买,穷人一个
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发表于 2006-8-31 11:13:56 | 显示全部楼层
支持,顶一下!
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发表于 2006-9-4 14:17:00 | 显示全部楼层
thanks
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发表于 2006-9-5 11:24:04 | 显示全部楼层
DDDDDDD
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发表于 2006-9-5 14:25:26 | 显示全部楼层
ddddddd
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发表于 2006-9-5 14:25:39 | 显示全部楼层
qqqqqq
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发表于 2006-9-5 14:26:01 | 显示全部楼层
ssssssssssssssssssssssssssssssssssssssss
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发表于 2006-9-15 20:01:10 | 显示全部楼层
正需要 不知道行不行
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发表于 2006-10-5 14:42:44 | 显示全部楼层

这是www.opencores.com上面的共享设计

楼主转载应该说明一下。BTW,这是I2C MASTER设计,不包括SLAVE模式,而且这个设计没有涉及Schmitt Trigger和Spike Suppression,因此在Fast-Mode下可能会有点儿问题。
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