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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 让锁存器不再让人头疼
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楼主: gougoudragon

让锁存器不再让人头疼

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发表于 2010-3-20 20:55:24 | 显示全部楼层
好东西 谢谢
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发表于 2010-3-20 21:05:38 | 显示全部楼层
不错，如果在设计中确实要用到latch，如何保证时序正确呢？
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发表于 2010-3-22 12:50:19 | 显示全部楼层
dddddddddddd
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lansky
发表于 2010-3-22 18:32:07 | 显示全部楼层
thanks
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发表于 2010-3-22 18:50:13 | 显示全部楼层
xue xi yi xia a
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ycbxbxb
发表于 2010-3-22 19:56:43 | 显示全部楼层
虾来看看
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zy1180
发表于 2010-4-6 23:54:05 | 显示全部楼层
学习中，谢谢了
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发表于 2010-4-14 22:56:49 | 显示全部楼层
学习中
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发表于 2010-5-8 21:31:00 | 显示全部楼层
谢谢楼主！！
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ljsh
发表于 2010-5-10 17:16:03 | 显示全部楼层
it is awesome
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