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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计讨论(IC前端|FPGA|ASIC) › 如何以硬件思维看穿你的verilog
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楼主: MACROY

[资料] 如何以硬件思维看穿你的verilog

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发表于 2021-9-28 08:29:14 来自手机 | 显示全部楼层
谢谢楼主
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wisen
发表于 2021-9-28 18:10:12 | 显示全部楼层
谢谢分享~~
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oakay
发表于 2021-9-28 20:10:02 | 显示全部楼层
先下载来看看，谢谢
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发表于 2021-10-15 11:09:46 | 显示全部楼层
楼主好人
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发表于 2022-3-4 14:08:15 | 显示全部楼层
thanks
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发表于 2022-3-4 14:31:55 | 显示全部楼层
赞一个，多看些知识辅助模拟设计
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xutao8
发表于 2022-3-9 16:07:08 | 显示全部楼层
学习一下
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nullptr
发表于 2022-3-23 22:41:02 | 显示全部楼层
谢谢
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发表于 2022-3-28 14:14:14 | 显示全部楼层
先赞再看，良好习惯
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发表于 2024-1-5 10:44:22 | 显示全部楼层
请问只是FPGA适用吗，能通用到ASIC的设计中吗
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