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楼主: number007cool

关于verilog的几点疑问

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发表于 2009-10-29 21:01:17 | 显示全部楼层
呵呵 习惯问题 两个always可以利用中间变量
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 楼主| 发表于 2009-11-1 15:17:19 | 显示全部楼层
明白了,多谢各位指教!!!!!!!!!!!!!!!!!!
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发表于 2009-11-2 16:19:48 | 显示全部楼层
版主快来干掉楼上的
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发表于 2009-11-3 16:28:52 | 显示全部楼层
要对一个信号在两个always里赋值最直接的办法是合并两个always,当然也可以做一个mux:a=sel?b:c; always b<=*;always c<=*;不过不推荐这种做法,这样会综合出多余的logic。
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发表于 2009-11-7 22:34:38 | 显示全部楼层
bucuobucuo
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