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ilku · 发表于 2025-6-29 11:22:49

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如图，顶层layout报错，都是显示的底层一个模块内部连线问题，请问这种问题大概是什么原因造成的呀，求各位大佬帮忙看看，谢谢啦！

bubushenghua · 发表于 2025-6-29 14:01:57

假设模块LVS没问题。有一种可能是顶层有一些线与这个模块的内部线短路了。不知道是否打开run short这个选项。

XPangZI · 发表于 2025-6-30 11:26:23

如果底层cell都能lvs pass的话，可以尝试带hcell跑，这样可以更清晰的知道是哪一层出了问题

wu1212 · 发表于 2025-6-30 16:39:42

对一下线有没有接反

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