关于组合和时序的问题

bupt_tian · 发表于 2023-11-25 13:42:32

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想问一下，比如一个16bit的行波进位加法器，如果要满足时钟频率在1GHz以上，是不是应该设计成时序的？比如在算到第8个bit的时候加个触发器？

xuxiuliv · 发表于 2023-11-29 15:47:19

是的用dff隔断大面积组合逻辑有助于工作频率的提高

liuguangxi · 发表于 2023-12-1 12:36:57

换成超前进位结构的加法器工作频率就能上去了

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