采样保持电路的输出建立太慢的问题

当当冒 · 发表于 2016-7-5 16:47:25

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如图，当输出的差分信号的电压很高时，建立时间很长，这个是什么原因呢？是运放的尾管电流太小吗？

tiancai3385 · 发表于 2016-7-6 13:46:36

如何怀疑是运放的问题，可以单独仿真下运放，接成buffer，仿真step响应。

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