在线咨询 切换到宽版
eetop公众号 创芯大讲堂 创芯人才网

 找回密码
 注册

手机号码,快捷登录

手机号码,快捷登录

搜帖子
楼主: 十八画生

[资料] Writing testbenches using systemVerilog

[复制链接]
发表于 2021-6-16 10:47:08 | 显示全部楼层
学习学习
回复 支持 反对

使用道具 举报

发表于 2021-7-30 09:46:19 | 显示全部楼层
学了
回复 支持 反对

使用道具 举报

发表于 2021-8-18 12:01:30 | 显示全部楼层
挺好的。
回复 支持 反对

使用道具 举报

发表于 2021-8-18 13:55:16 | 显示全部楼层
thanks
回复 支持 反对

使用道具 举报

发表于 2023-3-25 11:09:33 | 显示全部楼层
thanks
回复 支持 反对

使用道具 举报

发表于 2023-6-28 01:31:30 来自手机 | 显示全部楼层
感谢
回复 支持 反对

使用道具 举报

您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

手机版| 小黑屋| 关于我们| 联系我们| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2025-7-10 20:46 , Processed in 0.098548 second(s), 8 queries , Gzip On, MemCached On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表